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利用 PlanAhead 設計分析工具進行高級設計培訓

       華為，中科院，上海貝爾，中興，Xilinx,Intel英特爾,TI德州儀器，NI公司，Cadence公司,Synopsys，IBM，Altera，Oracle，synopsys，微軟，飛思卡爾，等大型公司高級工程師，項目經理，技術支持專家，曙海培訓，資深講師。

       大多名牌大學，碩士以上學歷，相關技術專業，有豐富的理論素養，十多年實際項目經歷，開發過多個大型項目，熱情，樂于技術分享。針對客戶實際需求，案例教學，邊講邊練，互動式溝通，學有所獲。

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        1、培訓過程中，如有部分內容理解不透或消化不好，可免費在以后培訓班中重聽；
        2、課程完成后,授課老師留給學員手機和Email,保障培訓效果,免費提供半年的技術支持。
        3、培訓合格學員可享受免費推薦就業機會。

課程對象
對通過分析和利用設計的物理實現得到佳性能表現感興趣的 FPGA 設計師、系統結構師和系統工程師

課程概要
1
PlanAhead 軟件回顧
實驗 1: PlanAhead 軟件回顧
RTL 開發和分析
實驗 2: RTL 分析
專用資源分配
實驗 3: 專用資源分配
Pblocks 簡介
布局規劃技術
2
布局規劃案例研究
實驗 4: 通過設計分析與布局規劃提高設計性能
利用分區功能實現設計保存
實驗 5: 利用設計保存功能以實現可預測結果
利用 ChipScope Pro 工具進行調試
實驗6：利用 ChipScope 工具進行調試
PlanAhead 軟件中的 Tcl 腳本
實驗7: Tcl 命令
(可選): 團隊設計
(可選): Virtex-6 器件中的布線優